FE2.1是一个高度集成，高质量，高性能，低功耗，低成本的解决方案的整体系统的USB 2高速集线器。
它采用多事务翻译（MTT）架构，探索最大可能的吞吐量。六，而不是两个，非周期的事务缓冲区，以尽量减少潜在的交通干扰。整个设计是基于状态机控制，以减少响应延迟时间，没有微控制器在该芯片中使用。
为了保证高质量，整个芯片被测试的扫描链–甚至包括高速（480mhz）模块，这样所有的逻辑组件可以在发货前进行充分的测试。特殊的内建自测试模式的设计运动都高，满，低速模拟前端（AFE）在封测阶段以及组件。
采用0.18μm技术和综合功率/时钟控制机制实现低功耗。
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FE2.1的框架图：
FE2.1的引脚分布：
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